문서의 임의 삭제는 제재 대상으로, 문서를 삭제하려면 삭제 토론을 진행해야 합니다. 문서 보기문서 삭제토론 AMD ZEN 마이크로아키텍처 (문단 편집) ==== 디스패치 ==== 마이크로 연산 명령어(μOP)의 디스패치(보내기) 능력은 정수 μOP의 경우 6 μOP/clock, 실수 μOP의 경우 4 μOP/clock이다. 즉 μOP 동시 처리 능력만 놓고 보면 경쟁사의 하스웰/브로드웰 아키텍처의 클럭당 4 명령어 디코딩을 넘어 클럭당 5 명령어 디코딩인 스카이레이크 아키텍처와 유사한 수준. 거기에 ZEN의 μOP는 상기한 바와 같이 명령어의 밀도가 높기 때문에 실질적인 스루풋은 그보다도 더 높을 가능성이 있다. 더군다나 ZEN은 정수 μOP와 실수 μOP를 동시에 각 스케줄러로 디스패치 할 수 있으므로[* http://www.anandtech.com/show/10591/amd-zen-microarchiture-part-2-extracting-instructionlevel-parallelism/3 "AMD that the dispatch unit can simultaneously dispatch to both INT and FP inside the same cycle, which can maximize throughput" ] 동시 디스패치 능력은 스카이레이크를 넘어선다. 다만 보통은 정수 명령과 실수 명령이 동시에 섞여서 들어오는 경우는 적기 때문에 현실적인 디스패치 속도는 정수부는 클럭당 6 μOPs, 실수부는 클럭당 2+4 μOPs정도이다. 벡터 명령어 위주의 실수 연산이라고 해도 메모리 입출력은 필요하기에 정수부의 로드/스토어 유닛은 실수 벡터 연산 과정에서도 비교적 바쁘게 움직인다. 다만, 코어당 2-way SMT에 의해 2개의 스레드에서 정수 명령어와 실수 명령어가 동시에 디스패치 유닛으로 들어오는 상황이라면 정수부와 실수부로의 디스패치가 동시에 수행되면서 이론상의 디스패치 속도에 근접하게 될 가능성은 있다. 실제로 ZEN의 SMT 효율은 인텔보다도 더 좋다는 의견이 대세이기도 하고.저장 버튼을 클릭하면 당신이 기여한 내용을 CC-BY-NC-SA 2.0 KR으로 배포하고,기여한 문서에 대한 하이퍼링크나 URL을 이용하여 저작자 표시를 하는 것으로 충분하다는 데 동의하는 것입니다.이 동의는 철회할 수 없습니다.캡챠저장미리보기